PhD Thesis / Thèses

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• TEL : archive server for PhD Thesis and HDRs in France / serveur multidisciplinaire d'archivage des thèses et HDR en France
• PhD thesis at IRISA / thèses à l'IRISA
  

IMPORTANT

• MATISSE: école doctorale  / doctoral school
  
• Scolarité des doctorants Université Rennes 1   (infos service, horaires, formalités AVANT/APRES soutenance, dépôt de la thèse...)

2011

• Erwan Raffin, Run-time Reconfigurable Systems: Compilation and Synthesis Aspects (13.07.2011)
  
• Thi Minh Nguyet Hoang, New techniques of scalable speech/audio coding for conversational applications: model-based bitplane coding and stereo extension of ITU-T G.722 (11.07.2011)

2010

• Muhammad Adeel Ahmed Pasha, System-Level Synthesis of Ultra Low-Power Wireless Sensor Network Node Controllers: A Complete Design-Flow (15/12/2010)

• Hung Manh Pham, Embedded computing architecture with dynamic hardware reconfiguration for intelligent automotive systems (15.12.2010)
• Ludovick Lepauloux, Distant multi-channel sound pick-up - Application to speech communication in adverse acoustic environments (08.12.2010)
• Shafqat Khan, Development of high performance hardware architectures for multimedia applications  (29.09.2010)
• Kevin Martin, Automatic Generation of Instruction-set Extensions (07.09.2010)
• Erwan Grace, Hiérarchie mémoire reconfigurable faible consommation pour systèmes enfouis
• Mohamed Djendi, Advanced techniques for two-microphone noise reduction in mobile communications (19.01.2010)

2009

• Renaud Santoro, Towards High-Rate Uniform and Gaussian Random Number Generators (17.12.2009)
• Faten Ben Abdallah, Development and optimization of dynamically reconfigurable processors (20.10.2009)
• Tuan-Duc Nguyen, Cooperative MIMO Strategies for Energy Constrained Wireless Sensor Networks (15.05.2009)

2008

• Julien Lallet, Mozaic: a generic platform for modeling and designing dynamically reconfigurable architectures (26.11.2008)
  
• Taofik Saidi, Hardware Architectures for WCDMA technology extended to mulitple-antenna systems (08.07.2008)
• Antoine Courtay, High-Level Power Estimation and Architectural Optimization for On-Chip Interconnection Networks 

2007

• Nicolas Hervé, Contributions à la synthèse d'architecture virgule fixe à largeurs multiples (12.03.2007)
  
• Imène Benkermi, Modèle et algorithme d'ordonnancement pour architectures reconfigurables dynamiquement (22.07.2007)
  

2006

• Mickaël Carton, Vers une plate-forme efficace en énergie pour les réseaux de capteurs sans fil (18.12.2006)
  
• Romuald Rocher, Evaluation analytique de la précision des systèmes en virgule fixe (07.12.2006)
  
• Ekué Kinvi-Boh, Conception de circuits en logique ternaire : de la caractérisation au niveau transistor à la modélisation architecturale (13.11.2006)
  

2005

• Madeleine Nyamsi Lonzenu, Prototypage d'architectures pour des applications de traitement numérique du signal (22.11.2005)
  
• Jean-Marc Philippe, Intégration des réseaux sur silicium : optimisation des couches physique et liaison (21.11.2005)
  
• Stéphane Chevobbe, Unité de commande pour systèmes parallèles : contrôleur basé sur l'implémentation dynamique de réseaux de Pétri (25.10.2005)
  

2003

• Anne-Claire Guillou, Synthèse architecturale basée sur le modèle polyédrique : validation et extensions de la méthodologie MMAlpha (19.12.2003)
  

• Raphaël David, Architecture reconfigurable dynamiquement pour applications mobiles (09.07.2003)
  

2002

• Daniel Ménard, Méthodologie de compilation d'algorithmes de traitement du signal en précision infinie pour les processeurs en virgule fixe (12.12.2002)
• Ferry Djiéya Nganchui, Contributions à la conception de systèmes de contrôle de trafic et de gestion de ressources en ATM (04.12.2002)
• Steven Derrien, Étude quantitative des techniques de partitionnement de réseaux de processeurs
  pour l’implantation sur circuits FPGA (02.12.2002)

• Raofeng Yu, Estimation de haut niveau du placement et des interconnexions de circuits VLSI submicroniques

• Alexandre Buisson, Implémentation efficace d'un codeur vidéo hiérarchique granulaire sur une architecture multi-pentium

• Matthieu Denoual, Estimation au niveau architectural de la consommation des systèmes intégrés dédiés au traitement numérique du signal

• Joseph Dedou, Synthèse architecturale des systèmes asynchrones

1999

• Jean-Gabriel Cousin, Méthodologie de conception de coeurs de processeurs spécifiques : mise en oeuvre sous contraintes, estimation de la consommation

1997

• Daniel Chillet, Méthodologie de conception architecturale des mémoires pour circuits dédiés au traitement du signal temps réel